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update duifei_basic_v1.0 and module ad9361_mapping
in duifei_basic_v1.0, ila of tx and rx signal is seperated into two ilas; in module ad9361_mapping, the DDR_CLK_MODE of rx mapping iddr is changed to SAME_EDGE, and the output iq of iddr is swappedto satisfy ad9361 data interface
This commit is contained in:
@@ -15,7 +15,7 @@
|
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},
|
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|
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|
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@@ -23,7 +23,7 @@
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@@ -34,6 +34,452 @@
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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},
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|
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|
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|
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|
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|
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|
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|
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}
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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}
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|
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|
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|
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|
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|
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|
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|
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},
|
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{
|
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|
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{
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|
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},
|
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{
|
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|
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},
|
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{
|
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"name": "rx_ch2_q[5]"
|
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},
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{
|
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|
||||
},
|
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{
|
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"name": "rx_ch2_q[3]"
|
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},
|
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{
|
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"name": "rx_ch2_q[2]"
|
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|
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|
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},
|
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|
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|
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|
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|
||||
}
|
||||
]
|
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|
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{
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|
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|
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"leftIndex": 0,
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
|
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"name": "rx_ch3_i[9]"
|
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},
|
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{
|
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|
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|
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|
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|
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|
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{
|
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|
||||
},
|
||||
{
|
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"name": "rx_ch3_i[5]"
|
||||
},
|
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{
|
||||
"name": "rx_ch3_i[4]"
|
||||
},
|
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{
|
||||
"name": "rx_ch3_i[3]"
|
||||
},
|
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{
|
||||
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|
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},
|
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{
|
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|
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|
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{
|
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|
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|
||||
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|
||||
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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|
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{
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|
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|
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{
|
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"name": "rx_ch3_q[6]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch3_q[5]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch3_q[4]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch3_q[3]"
|
||||
},
|
||||
{
|
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|
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|
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{
|
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|
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|
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|
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|
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|
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|
||||
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
|
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|
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|
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{
|
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|
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|
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{
|
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|
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|
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|
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|
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}
|
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]
|
||||
}
|
||||
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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},
|
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{
|
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|
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},
|
||||
{
|
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|
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|
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|
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|
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|
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|
||||
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|
||||
{
|
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|
||||
},
|
||||
{
|
||||
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|
||||
},
|
||||
{
|
||||
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|
||||
},
|
||||
{
|
||||
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|
||||
},
|
||||
{
|
||||
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|
||||
},
|
||||
{
|
||||
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|
||||
}
|
||||
]
|
||||
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|
||||
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|
||||
}
|
||||
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|
||||
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||||
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|
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|
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|
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|
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"uuid": "41C4DDF5215658A8812484234FB1A2B2",
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|
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|
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|
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|
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|
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|
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|
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|
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@@ -81,7 +527,7 @@
|
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|
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|
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|
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|
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|
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|
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|
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|
||||
@@ -132,438 +578,6 @@
|
||||
]
|
||||
}
|
||||
]
|
||||
},
|
||||
{
|
||||
"name": "probe2",
|
||||
"id": 2,
|
||||
"type": "DATA_TRIGGER",
|
||||
"direction": "IN",
|
||||
"isVector": true,
|
||||
"leftIndex": 0,
|
||||
"rightIndex": 11,
|
||||
"portIndex": 2,
|
||||
"nets": [
|
||||
{
|
||||
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|
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|
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|
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{
|
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|
||||
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|
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{
|
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|
||||
},
|
||||
{
|
||||
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|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_i[8]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_i[7]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_i[6]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_i[5]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_i[4]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_i[3]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_i[2]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_i[1]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_i[0]"
|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
||||
},
|
||||
{
|
||||
"name": "probe3",
|
||||
"id": 3,
|
||||
"type": "DATA_TRIGGER",
|
||||
"direction": "IN",
|
||||
"isVector": true,
|
||||
"leftIndex": 0,
|
||||
"rightIndex": 11,
|
||||
"portIndex": 3,
|
||||
"nets": [
|
||||
{
|
||||
"name": "rx_ch1_q",
|
||||
"isBus": true,
|
||||
"subnets": [
|
||||
{
|
||||
"name": "rx_ch1_q[11]"
|
||||
},
|
||||
{
|
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"name": "rx_ch1_q[10]"
|
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},
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{
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"name": "rx_ch1_q[9]"
|
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},
|
||||
{
|
||||
"name": "rx_ch1_q[8]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_q[7]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_q[6]"
|
||||
},
|
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{
|
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"name": "rx_ch1_q[5]"
|
||||
},
|
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{
|
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|
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},
|
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{
|
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|
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},
|
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{
|
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|
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|
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{
|
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|
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},
|
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{
|
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|
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}
|
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]
|
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}
|
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|
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|
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{
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
|
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|
||||
},
|
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{
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|
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},
|
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{
|
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|
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|
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{
|
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|
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|
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{
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|
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|
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{
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|
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|
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{
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|
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|
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{
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|
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|
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{
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|
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|
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|
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|
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|
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{
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|
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|
||||
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|
||||
}
|
||||
]
|
||||
},
|
||||
{
|
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|
||||
"id": 5,
|
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|
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|
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|
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"leftIndex": 0,
|
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|
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|
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|
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|
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|
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|
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|
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{
|
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|
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},
|
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{
|
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|
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},
|
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{
|
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|
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|
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{
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|
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},
|
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{
|
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"name": "rx_ch2_q[6]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[5]"
|
||||
},
|
||||
{
|
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"name": "rx_ch2_q[4]"
|
||||
},
|
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{
|
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"name": "rx_ch2_q[3]"
|
||||
},
|
||||
{
|
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"name": "rx_ch2_q[2]"
|
||||
},
|
||||
{
|
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|
||||
},
|
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{
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|
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}
|
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]
|
||||
}
|
||||
]
|
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|
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{
|
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|
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"id": 6,
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
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|
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},
|
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{
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|
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|
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{
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|
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},
|
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{
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|
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},
|
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{
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|
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},
|
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{
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|
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}
|
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]
|
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}
|
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]
|
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|
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{
|
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"name": "probe7",
|
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"id": 7,
|
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"type": "DATA_TRIGGER",
|
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|
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|
||||
"leftIndex": 0,
|
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"rightIndex": 11,
|
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|
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|
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|
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|
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|
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|
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|
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},
|
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{
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|
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},
|
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{
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|
||||
},
|
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{
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|
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},
|
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{
|
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"name": "rx_ch3_q[6]"
|
||||
},
|
||||
{
|
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"name": "rx_ch3_q[5]"
|
||||
},
|
||||
{
|
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"name": "rx_ch3_q[4]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch3_q[3]"
|
||||
},
|
||||
{
|
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|
||||
},
|
||||
{
|
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|
||||
},
|
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{
|
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|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
||||
},
|
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{
|
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|
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"id": 8,
|
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|
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|
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|
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"leftIndex": 0,
|
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"rightIndex": 11,
|
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|
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|
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{
|
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|
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|
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|
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{
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|
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|
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{
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
|
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|
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|
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{
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|
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|
||||
{
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|
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|
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{
|
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|
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|
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{
|
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|
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}
|
||||
]
|
||||
}
|
||||
]
|
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|
||||
{
|
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|
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"id": 9,
|
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|
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|
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|
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"leftIndex": 0,
|
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|
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|
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|
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|
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{
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|
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|
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|
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|
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{
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|
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|
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{
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|
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|
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{
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|
||||
},
|
||||
{
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|
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|
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{
|
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|
||||
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|
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{
|
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|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
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}
|
||||
]
|
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|
||||
@@ -574,7 +588,7 @@
|
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|
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|
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"uuid": "6DFBBD640CB857419C054C66C7EA7B27",
|
||||
|
||||
Binary file not shown.
@@ -15,7 +15,7 @@
|
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|
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{
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|
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|
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@@ -23,7 +23,7 @@
|
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|
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|
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|
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@@ -34,6 +34,452 @@
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||
{
|
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|
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}
|
||||
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|
||||
}
|
||||
]
|
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|
||||
{
|
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|
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|
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|
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|
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|
||||
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|
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|
||||
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|
||||
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|
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{
|
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|
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|
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|
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{
|
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|
||||
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|
||||
{
|
||||
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|
||||
},
|
||||
{
|
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|
||||
},
|
||||
{
|
||||
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|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_q[7]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_q[6]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_q[5]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_q[4]"
|
||||
},
|
||||
{
|
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|
||||
},
|
||||
{
|
||||
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|
||||
},
|
||||
{
|
||||
"name": "rx_ch1_q[1]"
|
||||
},
|
||||
{
|
||||
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|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
||||
},
|
||||
{
|
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|
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|
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|
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|
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|
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"leftIndex": 0,
|
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|
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|
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|
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{
|
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|
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|
||||
},
|
||||
{
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|
||||
},
|
||||
{
|
||||
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|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_i[7]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_i[6]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_i[5]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_i[4]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_i[3]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_i[2]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_i[1]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_i[0]"
|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
||||
},
|
||||
{
|
||||
"name": "probe3",
|
||||
"id": 3,
|
||||
"type": "DATA_TRIGGER",
|
||||
"direction": "IN",
|
||||
"isVector": true,
|
||||
"leftIndex": 0,
|
||||
"rightIndex": 11,
|
||||
"portIndex": 3,
|
||||
"nets": [
|
||||
{
|
||||
"name": "rx_ch2_q",
|
||||
"isBus": true,
|
||||
"subnets": [
|
||||
{
|
||||
"name": "rx_ch2_q[11]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[10]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[9]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[8]"
|
||||
},
|
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{
|
||||
"name": "rx_ch2_q[7]"
|
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},
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{
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||||
"name": "rx_ch2_q[6]"
|
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},
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{
|
||||
"name": "rx_ch2_q[5]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[4]"
|
||||
},
|
||||
{
|
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|
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},
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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|
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|
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|
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|
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},
|
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{
|
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|
||||
},
|
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{
|
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|
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},
|
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|
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|
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|
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},
|
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{
|
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|
||||
},
|
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{
|
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|
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},
|
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{
|
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|
||||
},
|
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|
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|
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|
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|
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{
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
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|
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|
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{
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|
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|
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{
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|
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},
|
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{
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|
||||
},
|
||||
{
|
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"name": "rx_ch3_q[5]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch3_q[4]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch3_q[3]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch3_q[2]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch3_q[1]"
|
||||
},
|
||||
{
|
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|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
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|
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{
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
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|
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},
|
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{
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|
||||
},
|
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{
|
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|
||||
},
|
||||
{
|
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"name": "rx_ch4_q[6]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch4_q[5]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch4_q[4]"
|
||||
},
|
||||
{
|
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|
||||
},
|
||||
{
|
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|
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|
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{
|
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|
||||
},
|
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{
|
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|
||||
}
|
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]
|
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|
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|
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@@ -132,438 +578,6 @@
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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{
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|
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|
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|
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|
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|
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|
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|
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|
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|
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},
|
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{
|
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|
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|
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{
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|
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|
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{
|
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|
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|
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{
|
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|
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|
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{
|
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|
||||
}
|
||||
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|
||||
}
|
||||
]
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||
},
|
||||
{
|
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|
||||
},
|
||||
{
|
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|
||||
},
|
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{
|
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|
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},
|
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{
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|
||||
},
|
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{
|
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|
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},
|
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{
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|
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|
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{
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|
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|
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{
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|
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|
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{
|
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|
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},
|
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{
|
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|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
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|
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{
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||
},
|
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{
|
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|
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|
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{
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|
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|
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|
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|
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|
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|
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|
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|
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{
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|
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|
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|
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|
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|
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|
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|
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},
|
||||
{
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|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
||||
},
|
||||
{
|
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|
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|
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|
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|
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|
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{
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|
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|
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{
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|
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},
|
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{
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|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[6]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[5]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[4]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[3]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[2]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch2_q[1]"
|
||||
},
|
||||
{
|
||||
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|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
||||
},
|
||||
{
|
||||
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|
||||
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|
||||
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|
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|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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|
||||
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|
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|
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{
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|
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|
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{
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|
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},
|
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{
|
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|
||||
},
|
||||
{
|
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|
||||
}
|
||||
]
|
||||
}
|
||||
]
|
||||
},
|
||||
{
|
||||
"name": "probe7",
|
||||
"id": 7,
|
||||
"type": "DATA_TRIGGER",
|
||||
"direction": "IN",
|
||||
"isVector": true,
|
||||
"leftIndex": 0,
|
||||
"rightIndex": 11,
|
||||
"portIndex": 7,
|
||||
"nets": [
|
||||
{
|
||||
"name": "rx_ch3_q",
|
||||
"isBus": true,
|
||||
"subnets": [
|
||||
{
|
||||
"name": "rx_ch3_q[11]"
|
||||
},
|
||||
{
|
||||
"name": "rx_ch3_q[10]"
|
||||
},
|
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{
|
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"name": "rx_ch3_q[9]"
|
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},
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"name": "rx_ch3_q[8]"
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},
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"name": "rx_ch3_q[7]"
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},
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"name": "rx_ch3_q[6]"
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},
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||||
"name": "rx_ch3_q[5]"
|
||||
},
|
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{
|
||||
"name": "rx_ch3_q[4]"
|
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{
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}
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]
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}
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@@ -574,7 +588,7 @@
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"ipName": "vio",
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"core_location": {
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"user_chain": 1,
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"uuid": "6DFBBD640CB857419C054C66C7EA7B27",
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