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# README.md
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> Board: DX_2Z7100_AD9528_2AD9361_V1.0
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> Device: xc7z100ffg900-2 (U1), ad9528 (U7), ad9361 (u8), ad9361 (u9)
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> Archiver: Josh Gao
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## 2024-11-14
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- 迁移到 Vivado 2024.1.2 版本，引入自动编译。
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## 2024-09-26
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- PL 增加编译选项，可以在 `system_top.v` 中定义 `AD9361_1_2T2R` 和 `AD9361_2_2T2R` 来启用 2T2R 时序，默认设置为 1T1R 模式。
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- PL 的时钟基频改为 60 MHz，考虑到 GW 采样率为 56 Msps；但是可能造成 TT 工作时钟过快，需要使用时进行相应调整。
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- PL 更改部分数据端口的命名。
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- PS 按照最新的对飞 PS 架构进行修改，需要 Include `include` 文件夹。
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- 修改 AD9361 的输入时钟为 40 MHz，二倍频接近 80 MHz 可以获得更好性能。
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- 两片 AD9361 的频点分别按照 TT 和 GW 修改，均仅启用一个收发通道。
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- 测试发送 EVM 约为 2%。
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## 2024-09-12
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1. 使用 PS 配置 AD9528 和两片 AD9361。
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2. AD9528 相关
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- 使用板上 50 MHz 晶振同时供给 VCO 和 REFA。
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- AD9361 时钟为 25 MHz，其他时钟均为 200 MHz。
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3. AD9361 配置相关
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- 默认启用 Rx2A 和 Tx2A，因此接收通道仅 `rx_ch2_i/q` 和 `rx_ch4_i/q` 有数据，具体请结合原理图。
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- 使用 25 MHz 时钟输入，采样率为 48 Msps，发送频率为 4125 MHz，接收频率为 125 MHz。
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4. PL 相关
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- PL 信号处理时钟 `sys_clk` 在 Clock Wizard 中为 50 MHz，但实际由 AD9361 输入随路时钟生成，频率为 48 MHz。
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## 2024-09-11
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- 初始版本，AD9361 使用 2T2R 模式。
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